問(wèn)答題假定最復(fù)雜的一條指令所用的組合邏輯分成6塊，依次為A~F，其延遲分別為80ps、30ps、60ps、50ps、70ps、10ps。在這些組合邏輯塊之間插入必要的流水段寄存器就可實(shí)現(xiàn)相應(yīng)的指令流水線，寄存器延遲為20ps。理想情況下，以下各種方式所得到的時(shí)鐘周期、指令吞吐率和指令執(zhí)行時(shí)間各是多少？應(yīng)該在哪里插入流水線寄存器？插入三個(gè)流水段寄存器，得到一個(gè)四級(jí)流水線
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當(dāng)存儲(chǔ)系統(tǒng)的訪問(wèn)效率為0.5時(shí)，計(jì)算命中率和等效訪問(wèn)周期。
題型：?jiǎn)柎痤}
求出流水線的最優(yōu)調(diào)度策略及最小平均延遲時(shí)間和流水線的最大吞吐率。
題型：?jiǎn)柎痤}
為了使存儲(chǔ)系統(tǒng)的訪問(wèn)效率從0.5提高到0.94，塊的大小至少增加到幾個(gè)字？
題型：?jiǎn)柎痤}
若傳送106個(gè)文字符號(hào)，且每個(gè)文字符號(hào)后均自動(dòng)跟一個(gè)空格，按最短的編碼，共需傳送多少個(gè)二進(jìn)制位？若傳送波特率為9600bPS，共需傳送多少時(shí)間？
題型：?jiǎn)柎痤}
至少要分配給該程序多少個(gè)主存頁(yè)面才能獲得最高的命中率？
題型：?jiǎn)柎痤}
有一個(gè)16KB4路組相聯(lián)Cache的32位微處理器，假定該Cache的塊為4個(gè)32位的字。主存地址為ABCDE8F8的單元在Cache中的什么位置。
題型：?jiǎn)柎痤}
要求操作碼的平均長(zhǎng)度最短，請(qǐng)?jiān)O(shè)計(jì)操作碼的編碼，并計(jì)算操作碼編碼的平均長(zhǎng)度。
題型：?jiǎn)柎痤}
若Cache的4個(gè)塊號(hào)為C0、C1、C2和C3，列出程序執(zhí)行過(guò)程中的Cache塊地址流。
題型：?jiǎn)柎痤}
如果把一條指令的執(zhí)行過(guò)程分解為“取指令”、“分析”（包括譯碼和取操作數(shù)等）和“執(zhí)行”（包括運(yùn)算和寫(xiě)回結(jié)果等）三個(gè)階段，并采用三級(jí)流水線。仍然要采用指令取消技術(shù)，請(qǐng)修改上面的程序。
題型：?jiǎn)柎痤}
畫(huà)出流水線任務(wù)調(diào)度的狀態(tài)有向圖。
題型：?jiǎn)柎痤}