假設(shè)加法器延時(shí)為1u.t.,乘法器延時(shí)為2u.t.,如圖所示電路的迭代邊界為()。
A.7
B.9/2
C.7/3
D.5
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假設(shè)加法器延時(shí)為1u.t.,乘法器延時(shí)為2u.t.,如圖所示電路的關(guān)鍵路徑的延時(shí)為()。
A.8
B.7
C.6
D.5
A.不操作
B.節(jié)點(diǎn)的每條輸入邊增加()延時(shí),同時(shí)節(jié)點(diǎn)的每條輸出邊減少()延時(shí)
C.節(jié)點(diǎn)的每條輸入邊減少()延時(shí),同時(shí)節(jié)點(diǎn)的每條輸出邊增加()延時(shí)
D.節(jié)點(diǎn)的每條輸入邊增加()延時(shí),同時(shí)節(jié)點(diǎn)的每條輸出邊增加()延時(shí)
A.重定時(shí)路徑的權(quán)重與中間節(jié)點(diǎn)的重定時(shí)值有關(guān)
B.重定時(shí)會(huì)改變環(huán)路的總延時(shí)數(shù)
C.重定時(shí)不改變DFG的迭代邊界
D.所有節(jié)點(diǎn)重定時(shí)值都增加常數(shù)值j后,重定時(shí)映射G→Gr發(fā)生改變
如圖所示的電路經(jīng)過(guò)重定時(shí)后的可能的寄存器數(shù)有()。
A.7
B.6
C.5
D.3
A.重定時(shí)能夠改變關(guān)鍵路徑長(zhǎng)度
B.重定時(shí)能夠改變寄存器的個(gè)數(shù)
C.重定時(shí)會(huì)改變電路的功能
D.重定時(shí)不會(huì)改變寄存器在電路中的位置
最新試題
編譯碼設(shè)備較復(fù)雜的差錯(cuò)控制方式是()。
在維特比譯碼中,當(dāng)每個(gè)節(jié)點(diǎn)有兩條路徑同時(shí)到達(dá)時(shí)(如下),如何舍棄其中一條路徑?()
()是利用多進(jìn)制數(shù)字基帶信號(hào)去控制載波的幅度、頻率或相位。
分組碼一般可用(n,k)表示,若碼組(7,3)中,監(jiān)督碼數(shù)目為()。
某線性分組碼(n,k)中的n表示()。
數(shù)字調(diào)制是指基帶信號(hào)是()、載波為正弦波的調(diào)制。
任一分組碼,若要在碼字內(nèi)檢測(cè)3個(gè)隨機(jī)錯(cuò)誤,則要求碼的最小距離是()。
差錯(cuò)控制的實(shí)質(zhì)是給信息碼元增加()。
實(shí)現(xiàn)振幅調(diào)制,應(yīng)采用()。
通常,分組碼任意兩個(gè)碼字之間距離用()衡量。