單項(xiàng)選擇題

圖示時(shí)序路徑中，從時(shí)鐘輸入端口到寄存器a時(shí)鐘管腳存在延遲時(shí)間Tclk1；寄存器從接收到有效上升沿后，到數(shù)據(jù)輸出到寄存器a的Q管腳的延遲時(shí)間Tco；數(shù)據(jù)從寄存器a（上級(jí)寄存器）輸出管腳Q到寄存器b（下級(jí)寄存器）的輸入管腳D之間（包括之間的組合邏輯及線路）的延遲時(shí)間Tdata，則以啟動(dòng)沿作為時(shí)間起點(diǎn)，其數(shù)據(jù)達(dá)到時(shí)間為（）。

A.Tclk1+Tco+Tdata
B.啟動(dòng)沿+Tclk1+Tco
C.啟動(dòng)沿+Tclk1+Tco+Tdata
D.啟動(dòng)沿+Tco+Tdata


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1.多項(xiàng)選擇題以下模塊屬于需授權(quán)使用的IP核的有（）。

A.FIR
B.SPI
C.累加器
D.FIFO

2.多項(xiàng)選擇題?以下關(guān)于可綜合代碼常用指導(dǎo)原則描述正確的是（）。

A.避免使用延時(shí)語(yǔ)句
B.可以使用循環(huán)次數(shù)不確定的循環(huán)語(yǔ)句
C.對(duì)同一個(gè)賦值對(duì)象既能使用阻塞式賦值，又使用非阻塞式賦值
D.避免使用initial語(yǔ)句

3.單項(xiàng)選擇題

下圖所描述的狀態(tài)機(jī)類(lèi)型為（）。

A.改型米勒狀態(tài)機(jī)
B.米勒（Mealy）狀態(tài)機(jī)
C.改型摩爾狀態(tài)機(jī)
D.摩爾（Moore）狀態(tài)機(jī)

4.多項(xiàng)選擇題以下關(guān)于EGO1開(kāi)發(fā)平臺(tái)說(shuō)法正確的是（）。

A.VGA接口通過(guò)14位信號(hào)線與FPGA連接
B.EGO1僅提供JTAG和SPI兩種配置方式
C.按鍵默認(rèn)為高電平
D.音頻接口輸入信號(hào)只能為PWM形式

5.多項(xiàng)選擇題?以下關(guān)于DE2-70開(kāi)發(fā)平臺(tái)數(shù)碼管與LED說(shuō)法正確的是（）。

A.數(shù)碼管為共陰極數(shù)碼管
B.LED高電平點(diǎn)亮
C.數(shù)碼管為共陽(yáng)極數(shù)碼管
D.LED低電平點(diǎn)亮