A.主BPI配置模式數(shù)據(jù)為并行形式
B.主SPI配置比主BPI配置速度要慢
C.主SPI可以支持x1、x2、x4三種加載模式,三種加載模式加載速度不同
D.JTAG配置模式無法存儲邏輯代碼,只能在線調(diào)試
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A.FPGA時鐘資源有全局時鐘網(wǎng)絡(luò)、區(qū)域時鐘網(wǎng)絡(luò)以及專有時鐘資源
B.一般情況使用普通IO作為時鐘引腳使用
C.全局時鐘網(wǎng)絡(luò)與本 區(qū)域時鐘網(wǎng)絡(luò)在本 區(qū)域延遲時間一致
D.區(qū)域時鐘網(wǎng)絡(luò)帶載能力和全局延遲不如全局時鐘引腳
A.FPGA可以靈活的對數(shù)字計(jì)算進(jìn)行并行化、流水線等優(yōu)化
B.FPGA可以作為協(xié)處理器,在數(shù)據(jù)中心可以完成計(jì)算密集型和通信密集型任務(wù),以減輕CPU的壓力
C.FPGA可以方便地進(jìn)行ASIC驗(yàn)證
D.FPGA在圖像處理方面相較于CPU更加靈活,但功耗更高
A.完成bit文件生成之后
B.完成ZYNQ處理器設(shè)計(jì)之后
C.完成仿真驗(yàn)證,確保硬件功能無誤之后
D.完成設(shè)計(jì)綜合之后
A.XC7S100
B.XC7Z100
C.XC7VX330T
D.XC7K325T
A.125MHz
B.100MHz
C.156MHz
D.1.25GHz
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