單項(xiàng)選擇題若在一個(gè)總線周期中,CPU對READY信號(hào)進(jìn)行了5次采樣,那么該總線周期共包含()個(gè)時(shí)鐘周期。
A.5
B.6
C.7
D.8
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3.單項(xiàng)選擇題CPU在執(zhí)行IN AL,DX指令時(shí),DX的內(nèi)容輸出到()
A.地址總線
B.數(shù)據(jù)總線
C.存儲(chǔ)器
D.寄存器
4.單項(xiàng)選擇題軟中斷INTn(n=10~FFH)的優(yōu)先級(jí)排列原則是()。
A.n值越小級(jí)別越高
B.無優(yōu)先級(jí)別
C.n值越大級(jí)別越高
D.隨應(yīng)用而定
最新試題
通過條件轉(zhuǎn)移指令JXX可以實(shí)現(xiàn)分支結(jié)構(gòu)程序的編寫。()
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I2C總線的通信速率僅由主機(jī)確定。
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要組成32M×8bit的存儲(chǔ)器,需要1M×4bit的存儲(chǔ)芯片共()片。
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按照是否需要刷新操作分類,RAM可分為()和()。
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在一個(gè)較短的時(shí)間間隔內(nèi),CPU訪問存儲(chǔ)器時(shí),無論是存取指令還是存取數(shù)據(jù),所訪問的存儲(chǔ)單元都趨于聚集在一個(gè)較小的連續(xù)區(qū)域中,而對此范圍以外的地址訪問甚少的現(xiàn)象就稱為程序訪問的()性。
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在IN和OUT指令中,當(dāng)端口號(hào)大于FFH(255)時(shí),必須通過()間接給出。
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10號(hào)DOS系統(tǒng)功能調(diào)用可以用于將多個(gè)字符輸入到指定緩沖區(qū)之中。()
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SPI總線是一種()形總線結(jié)構(gòu),在SCLK時(shí)鐘信號(hào)的控制下,兩個(gè)雙向()寄存器進(jìn)行數(shù)據(jù)交換。
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某存儲(chǔ)器系統(tǒng)要求采用3:8譯碼器對A19~A15進(jìn)行全譯碼,需要()片。
題型:單項(xiàng)選擇題
嵌入式系統(tǒng)接口擴(kuò)展的4種基本方法是()、()、()和通信擴(kuò)展。
題型:填空題