多項(xiàng)選擇題以下關(guān)于ADC和DAC布局說(shuō)法正確的有（）。

A.發(fā)送電路和接收電路必須進(jìn)行隔離處理
B.ADC、DAC前端模擬電路放置在模擬區(qū)，數(shù)字輸出電路放置在數(shù)字區(qū)，分區(qū)放置
C.如果有多路模擬輸入或者多路模擬輸出的情況，在每路之間也要做地分割處理，然后在芯片處做單點(diǎn)接地處理
D.開(kāi)關(guān)電源、時(shí)鐘電路、大功率器件遠(yuǎn)離ADC、DAC器件和信號(hào)


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1.多項(xiàng)選擇題以下關(guān)于ADC和DAC模擬部分布線說(shuō)法正確的有（）。

A.模擬地AGND和數(shù)字地DGND依據(jù)數(shù)據(jù)手冊(cè)和提供的參考設(shè)計(jì)進(jìn)行分割處理，單點(diǎn)連接
B.模擬電路應(yīng)該采用開(kāi)關(guān)電源進(jìn)行供電，因?yàn)槠潆娏餍?、紋波小
C.模擬信號(hào)優(yōu)先采用元件面直接走線，線寬≥10mil，對(duì)50歐姆單端線、100歐姆差分信號(hào)要采用隔層參考
D.嚴(yán)格按照原理圖的順序進(jìn)行ADC和DAC前端電路布線

2.多項(xiàng)選擇題以下關(guān)于ADC和DAC數(shù)字部分布線說(shuō)法正確的有（）。

A.不同ADC/DAC器件的采樣時(shí)鐘之間不需要做等長(zhǎng)處理
B.當(dāng)信號(hào)線必須要跨分割時(shí)，跨接點(diǎn)選擇在跨接磁珠（或者0歐姆電阻）處
C.模擬信號(hào)優(yōu)先采用元件面直接走線，線寬≥10mil，采用隔層參考
D.數(shù)字部分的接收與發(fā)送分開(kāi)布線，不要交叉走線，同組信號(hào)線并行走，并做等長(zhǎng)處理，走線間距滿足3W

3.單項(xiàng)選擇題某高精度ADC芯片輸出為12bitLVDS數(shù)據(jù)信號(hào)，輸入時(shí)鐘頻率為100Mhz，則這些LVDS數(shù)據(jù)應(yīng)該（）與等長(zhǎng)。

A.工作時(shí)鐘信號(hào)
B.采樣時(shí)鐘信號(hào)
C.輸入時(shí)鐘信號(hào)
D.隨路時(shí)鐘信號(hào)

5.單項(xiàng)選擇題10°走線主要為了克服（）而專門(mén)作出特殊要求的。

A.銅箔粗糙度
B.趨膚效應(yīng)
C.波纖效應(yīng)
D.反射效應(yīng)