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問(wèn)答題設(shè)計(jì)一個(gè)組合電路，輸入為A、B、C，輸出為Y。當(dāng)C=0時(shí)，實(shí)現(xiàn)Y=AB；當(dāng)C=1時(shí)，實(shí)現(xiàn)Y=A+B。要求：完全用與非門實(shí)現(xiàn)該邏輯關(guān)系。

參考答案：

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1.問(wèn)答題設(shè)計(jì)一個(gè)組合電路，輸入為A、B、C，輸出為Y。當(dāng)C=0時(shí)，實(shí)現(xiàn)Y=AB；當(dāng)C=1時(shí)，實(shí)現(xiàn)Y=A+B。要求：求輸出Y的最簡(jiǎn)與或表達(dá)式。

參考答案：Y=AB+BC+AC

2.問(wèn)答題 用74LS161設(shè)計(jì)一個(gè)9進(jìn)制計(jì)數(shù)器。
異步清零法。

參考答案：

3.問(wèn)答題 用74LS161設(shè)計(jì)一個(gè)9進(jìn)制計(jì)數(shù)器。
同步預(yù)置法，已知S₀＝0001。

參考答案：

4.問(wèn)答題 已知下圖所示的時(shí)序邏輯電路，假設(shè)觸發(fā)器的初始狀態(tài)均為“0”，試分析：

說(shuō)明該計(jì)數(shù)器能否自啟動(dòng)。

參考答案：能自啟動(dòng)。

5.問(wèn)答題 已知下圖所示的時(shí)序邏輯電路，假設(shè)觸發(fā)器的初始狀態(tài)均為“0”，試分析：

畫出狀態(tài)轉(zhuǎn)換表，狀態(tài)圖，指出是幾進(jìn)制計(jì)數(shù)器。

參考答案：

七進(jìn)制計(jì)數(shù)器。