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判斷題對于十進(jìn)制純小數(shù)，求它的二進(jìn)制表示可以采用“除2取余”法。

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1.問答題 如圖所示的電路，虛線框內(nèi)是CMOS門電路構(gòu)成的微分型單穩(wěn)態(tài)觸發(fā)器；單穩(wěn)態(tài)觸發(fā)器的反相輸出作為D觸發(fā)器的時鐘；試分析：
（1）設(shè)R=30kΩ，C=0.1μF，CMOS門限為V_TH=V_DD/2，R_d·C_d<<R·C，求單穩(wěn)態(tài)觸發(fā)器輸出脈沖的寬度T_W；（計算中取 ln2 ≈0.69）
（2）根據(jù)圖中v_I的波形，繪出和v_O的波形。

參考答案：

2.問答題 設(shè)現(xiàn)有正邊沿觸發(fā)的JK觸發(fā)器和與非門元件，數(shù)目不限。如圖，給定時鐘脈沖序列CLK，請?jiān)O(shè)計同步時序邏輯電路，以實(shí)現(xiàn)Y₁和Y₂的波形輸出。
（1）根據(jù)設(shè)計需求，請簡要說明電路設(shè)計的思路；
（2）推導(dǎo)出電路的狀態(tài)方程、輸出方程、驅(qū)動方程，并要求驅(qū)動邏輯最簡；
（3）繪制出電路的原理圖，并要求能夠自啟動。

參考答案：

3.問答題 分析圖給出的計數(shù)器電路，74LS161為同步二進(jìn)制計數(shù)器，其功能表見表。請寫出分析思路，并說明這是多少進(jìn)制的計數(shù)器。

參考答案：

4.問答題 電路如圖所示，F(xiàn)F₁和FF為邊沿觸發(fā)JK觸發(fā)器，初始狀態(tài)均為0，請按照給定的輸入信號波形（如圖），繪出輸出信號Q₁和Q₂端的波形。

參考答案：

5.問答題 由1位全加器、2-4譯碼器以及與非門組成的邏輯電路如圖所示，試寫出最小項(xiàng)之和形式的邏輯函數(shù)F（a，b，c，d）。（不用化簡）

參考答案：