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問答題 根據下圖，寫出頂層文件MX3256.VHD的VHDL設計文件。

參考答案：

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1.問答題 給出1位全減器的VHDL描述。要求：
（1）首先設計1位半減器，然后用例化語句將它們連接起來，圖中h_suber是半減器，diff是輸出差，s_out是借位輸出，sub_in是借位輸入。
（2）以1位全減器為基本硬件，構成串行借位的8位減法器，要求用例化語句來完成此項設計（減法運算是x–y-sun_in=diffr）。

參考答案：

2.問答題 圖中是一個含有上升沿觸發(fā)的D觸發(fā)器的時序電路，試寫出此電路的VHDL設計文件。

參考答案：

3.問答題 圖中所示的是雙2選1多路選擇器構成的電路MUXK，對于其中MUX21A，當s=‘0’和‘1’時，分別有y<=‘a’和y<=‘b’。試在一個結構體中用兩個進程來表達此電路，每個進程中用CASE語句描述一個2選1多路選擇器MUX21A。

參考答案：

4.問答題 圖中所示的是4選1多路選擇器，試用CASE語句的表達方式寫出此電路的VHDL程序。
選擇控制的信號s1和s0為STD_LOGIC_VECTOR類型；
當s1=‘0’，s0=‘0’；s1=‘0’，s0=‘1’；s1=‘1’，s0=‘0’和s1=‘1’，s0=‘1’分別執(zhí)行y<=a、y<=b、y<=c、y<=d。

參考答案：

5.問答題 畫出下例實體描述對應的原理圖符號元件：

參考答案：