單項(xiàng)選擇題與非門的兩個(gè)輸入端為下列哪一種時(shí)，其輸出為0？（）

A.1，l
B.1，0
C.0，1
D.0，0


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1.單項(xiàng)選擇題下列布爾代數(shù)恒等式哪項(xiàng)不正確？（）

A.X+XY＝X
B.（X+Y）（Y+Z）＝X+YZ
C.X（X+Y）＝X

2.單項(xiàng)選擇題二進(jìn)制數(shù)-0.0110的補(bǔ)碼是（）。

A.1.1010
B.1.0101
C.1.0110
D.1.1011

3.單項(xiàng)選擇題余3碼10101000對(duì)應(yīng)的2421碼為（）。

A.10101110
B.10101000
C.11011011
D.01110101

最新試題

電平異步時(shí)序邏輯電路工作的基本條件有（）。

題型：多項(xiàng)選擇題

輸出端與輸出端可以直接連接，實(shí)現(xiàn)“線與”的門電路有（）。

題型：?jiǎn)雾?xiàng)選擇題

現(xiàn)場(chǎng)可編程門陣列FPGA的設(shè)計(jì)流程中，下列屬于規(guī)劃設(shè)計(jì)階段的工作有（）。

題型：多項(xiàng)選擇題

對(duì)于一個(gè)輸入為XYZ的脈沖異步時(shí)序邏輯電路，下面的輸入脈沖組合中，（）是允許的。

題型：多項(xiàng)選擇題

現(xiàn)場(chǎng)可編程門陣列FPGA的基本結(jié)構(gòu)由（）組成。

題型：多項(xiàng)選擇題

?用3線-8線譯碼器74138（邏輯符號(hào)如下圖所示）和與非門實(shí)現(xiàn)函數(shù)的功能時(shí)，74138的輸出端（）連接與非門。?

題型：?jiǎn)雾?xiàng)選擇題

下圖所示CMOS電路實(shí)現(xiàn)的邏輯是（）。

題型：?jiǎn)雾?xiàng)選擇題

邏輯函數(shù)F（A，B，C，D）=∑m（2，7，8，12，13，14，15）的卡諾圖，下面畫法正確的是（）。

題型：?jiǎn)雾?xiàng)選擇題

下面圖示的電路可以實(shí)現(xiàn)（）功能。

題型：?jiǎn)雾?xiàng)選擇題

假定描述一個(gè)同步時(shí)序電路的最簡(jiǎn)狀態(tài)表中有6個(gè)狀態(tài)，則該電路中有（）個(gè)觸發(fā)器，電路中存在（）個(gè)多余狀態(tài)。?

題型：?jiǎn)雾?xiàng)選擇題