A.串化解串模塊
B.協(xié)議解析模塊
C.光纖模塊
D.光電轉(zhuǎn)換模塊
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A.512
B.9
C.8
D.28
?FPGA實(shí)現(xiàn)DDS架構(gòu)的設(shè)計(jì)如圖所示，包括分頻器、地址發(fā)生器及波形存儲(chǔ)器，分頻系數(shù)divider[15..0]、步長(zhǎng)freq[1..0]，改變哪個(gè)參數(shù)可以改變輸出信號(hào)的頻率？（）
A.freq[1..0]
B.clk
C.divider[15..0]
D.rst
A.地址
B.頻率
C.相位
D.存儲(chǔ)
圖示時(shí)序路徑，其數(shù)據(jù)建立需求時(shí)間為（）。
A.捕獲沿+Tclk2-Tsu
B.捕獲沿+Tclk1+Tsu
C.捕獲沿+Tclk2+Tsu
D.捕獲沿+Tclk1-Tsu
A.1、4
B.4、4
C.1、1
D.4、1
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