多項(xiàng)選擇題關(guān)于VHDL描述風(fēng)格的說(shuō)法正確的有（）。

A.三種描述風(fēng)格分別適用于不同應(yīng)用場(chǎng)合
B.功能描述也稱行為描述，最能體現(xiàn)HDL語(yǔ)言的強(qiáng)大建模能力，應(yīng)用最廣泛
C.結(jié)構(gòu)化描述最典型的語(yǔ)句就是元件例化，是實(shí)現(xiàn)層次化設(shè)計(jì)頂層模塊化描述的利器
D.數(shù)據(jù)流描述適用于比較簡(jiǎn)單的電路模塊設(shè)計(jì)


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1.多項(xiàng)選擇題EDA設(shè)計(jì)電路中毛刺產(chǎn)生的原因包括（）。

A.不同信號(hào)傳輸路徑延時(shí)時(shí)間不同
B.存在隨機(jī)干擾信號(hào)和信號(hào)抖動(dòng)
C.FPGA或CPLD器件內(nèi)幾乎沒(méi)有分布電容或電感過(guò)濾毛刺
D.信號(hào)傳輸存在延時(shí)

4.多項(xiàng)選擇題關(guān)于簡(jiǎn)易正弦信號(hào)發(fā)生器設(shè)計(jì)，以下描述正確的有（）。

A.ROM中的數(shù)據(jù)預(yù)先保存成一個(gè)數(shù)據(jù)文件，存放在頂層設(shè)計(jì)文件所在的WORK庫(kù)文件夾。
B.地址發(fā)生器就是一個(gè)計(jì)數(shù)器，用來(lái)控制對(duì)ROM單元存儲(chǔ)數(shù)據(jù)的讀寫，所以其模值等于單元個(gè)數(shù)。
C.在FPGA中實(shí)現(xiàn)的ROM并非真正的ROM。
D.在FPGA中實(shí)現(xiàn)的ROM是一個(gè)真正的ROM。

5.多項(xiàng)選擇題關(guān)于面積優(yōu)化的描述正確的有（）。

A.最常用的面積優(yōu)化方法是資源共享法
B.任何功能塊都可以實(shí)現(xiàn)面積優(yōu)化
C.面積優(yōu)化就是資源優(yōu)化
D.面積優(yōu)化可以降低功耗