單項(xiàng)選擇題assign #(5,3,7)w_or =∣bus;如果該表達(dá)式右側(cè)結(jié)果為0,則延遲為()。

A.5
B.3
C.7
D.0


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4.單項(xiàng)選擇題下列代碼t < =a ~^k;實(shí)現(xiàn)的功能為()。

A.t=ak
B.t=a同或B
C.t=a異或b
D.t左移ak位

5.多項(xiàng)選擇題下列哪種技術(shù)是基于JTAG技術(shù)構(gòu)建的?()

A.SignalTap II
B.ModelSim門(mén)級(jí)仿真
C.Synplify綜合器綜合技術(shù)
D.In-System Source and Probe
E.FPGA在線配置技術(shù)
F.In-System Memory Content Editor