A.優(yōu)先選擇參考平面是地平面的信號(hào)層走線
B.依照布局情況最短布線
C.走線間距單端線必須滿足3W以上,差分線對(duì)間距必須滿足20mil以上
D.走線少打過(guò)孔,優(yōu)先在過(guò)孔Stub最短的布線層布線
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A.疊層對(duì)稱(chēng)性(銅厚、介質(zhì))
B.阻抗連續(xù)性
C.主元件面相鄰層為優(yōu)選地層
D.電源和地平面緊耦合
A.低電壓大電流(如CPU、FPGA、DSP的核電源、DDR電源等)
B.高電壓大電流(如單板的總電源如12V等)
C.電源分布范圍較大的電源(如5V/3.3V/1.8V/1.5V此類(lèi)整板電源)
D.電流大于1A以上的電源(如CPU、FPGA、DSP等芯片的IO電源)
A.電解電容、鉭電容布局時(shí)極性方向要一致
B.TVS管、ESD、保險(xiǎn)絲等保護(hù)器件靠近接口放置
C.熱敏器件不允許靠近大功率器件布局
D.數(shù)字、模擬器件分區(qū)布局
A.推薦設(shè)計(jì)單位為mil,精度小數(shù)點(diǎn)后2位、設(shè)計(jì)單位也可為mm,精度小數(shù)點(diǎn)后4位
B.以上兩種單位、設(shè)計(jì)過(guò)程中可以多次轉(zhuǎn)換
C.板框Outline繪制時(shí),可以采用線寬0mil設(shè)計(jì)
D.發(fā)現(xiàn)板子存在直角時(shí),可提醒客戶要進(jìn)行適當(dāng)?shù)菇?/p>
A.I/O管腳、Input管腳或者Output管腳可調(diào)整
B.FPGA內(nèi)電平一樣的管腳之間都可以調(diào)整
C.配置管腳可以調(diào)整
D.對(duì)于全局時(shí)鐘管腳,只能在全局時(shí)鐘管腳間進(jìn)行調(diào)整,并與客戶進(jìn)行確認(rèn)
最新試題
在設(shè)置原理圖的工作環(huán)境中,圖紙的標(biāo)題欄格式有哪幾種?()
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常見(jiàn)錯(cuò)誤報(bào)告中出現(xiàn):Duplicate Component Designators …表示什么意思?()
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