A.∑m(3,5,6,7)
B.∑m(0,1,2,4)
C.∏m(1,3,5,7)
D.∑M(0,2,4,6)
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A.4個
B.8個
C.15個
D.16個
A.AB
B.ABC
C.BCD
D.ABCD
A.10110
B.11001
C.11010
D.00110
A.100100.01
B.110011.10
C.101110.01
D.110110.10
A.00001111
B.01001000
C.00011011
D.00010101
最新試題
為了實現(xiàn)計數(shù)功能,集成寄存器74194的控制端S0S1可以是()。
現(xiàn)場可編程門陣列FPGA的基本結構由()組成。
?具有3個選擇控制端的數(shù)據(jù)選擇器能對()個輸入數(shù)據(jù)進行選擇,對應選擇輸入端的任何一種取值,可選中()個輸入數(shù)據(jù)輸出。?
輸出端與輸出端可以直接連接,實現(xiàn)“線與”的門電路有()。
設計一個Moore型同步可重疊的“1101”序列檢測器,至少需要()個觸發(fā)器。
?設計一個mealy型的110序列檢測器,需要()個觸發(fā)器,而設計moore型的110序列檢測器則需要()個觸發(fā)器。?
如下圖所示的原始狀態(tài)表,其中的等效對有()。
一個n位的D/A換器的分辨率為()。
使用8路選擇器實現(xiàn)4變量邏輯函數(shù)F(A,B,C,D),使用ABC作為控制變量,數(shù)據(jù)輸入端D0-D7可能的值有()。
邏輯函數(shù)F(A,B,C,D)=∑m(2,7,8,12,13,14,15)的卡諾圖,下面畫法正確的是()。