最新試題

如圖,此電路的輸入端I0_L是低電平有效,輸出A2A1A0是高電平有效,AVALID有效表示的是()。

題型:單項選擇題

如圖,是151的電路設計,其中輸入端的使用了6個反相器,而實現(xiàn)邏輯功能應該可以省掉三個,為什么這么設計()。

題型:單項選擇題

已知函數(shù)F(A,B,C,D)=(AB’)’+(C’D+B’C)’,則其最簡表達式為()。

題型:單項選擇題

?若集成塊內(nèi)部為驅(qū)動單元提供的驅(qū)動能力為1X,對于下圖所示的輸出緩沖設計(圖中反相器上面標注了相應的驅(qū)動能力),該輸出單元的延遲時間(從a到y(tǒng))相當于()個內(nèi)部標準門級聯(lián)的延遲時間。

題型:單項選擇題

?如圖所示電路論述正確的是()。

題型:多項選擇題

若集成塊內(nèi)部為驅(qū)動單元提供的驅(qū)動能力為1X,最小反相器(1X)延遲時間為2,對于下圖所示的輸出緩沖設計(圖中反相器上面標注了相應的驅(qū)動能力),該輸出單元的延遲時間(從a到y(tǒng))最接近于()。

題型:單項選擇題

若集成塊內(nèi)部為驅(qū)動單元提供的驅(qū)動能力為1X,最小反相器(1X)延遲時間為2,對于下圖所示的輸出緩沖設計(圖中反相器上面標注了相應的驅(qū)動能力),該輸出單元的延遲時間(從a到y(tǒng))最接近于()。

題型:單項選擇題

CC4000系列的CMOS門電路不能直接接()系列的門電路。

題型:單項選擇題

要使TTL與非門變成反相器,多余的輸入端不能采用的方法為()。

題型:單項選擇題

關于集成塊的輸出單元,下列說法中正確的是()。

題型:多項選擇題