問答題
CMOS門電路如題圖所示。
(1)寫出電路輸出Y1~Y3的邏輯表達(dá)式。
(2)已知輸入A,B的波形如題圖(d)所示,畫出Y1~Y3的波形。
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通常,使用參數(shù)()來衡量D/A轉(zhuǎn)換器的轉(zhuǎn)換速度。
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如下圖所示的原始狀態(tài)表,其中的等效對(duì)有()。
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?如下圖所示時(shí)序電路,該電路是一個(gè)()型電路,其功能是()。
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現(xiàn)場可編程門陣列FPGA的設(shè)計(jì)流程中,下列屬于規(guī)劃設(shè)計(jì)階段的工作有()。
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反映TTL與非門輸入高電平時(shí)抗干擾能力的外部特性參數(shù)是()。
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?具有3個(gè)選擇控制端的數(shù)據(jù)選擇器能對(duì)()個(gè)輸入數(shù)據(jù)進(jìn)行選擇,對(duì)應(yīng)選擇輸入端的任何一種取值,可選中()個(gè)輸入數(shù)據(jù)輸出。?
題型:單項(xiàng)選擇題
?設(shè)計(jì)一個(gè)mealy型的110序列檢測器,需要()個(gè)觸發(fā)器,而設(shè)計(jì)moore型的110序列檢測器則需要()個(gè)觸發(fā)器。?
題型:單項(xiàng)選擇題
電平異步時(shí)序邏輯電路工作的基本條件有()。
題型:多項(xiàng)選擇題