A.分辨率
B.非線性誤差
C.絕對(duì)精度
D.建立時(shí)間
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A.1
B.2
C.3
D.4
A.00
B.01
C.10
D.11
下面圖示的電路可以實(shí)現(xiàn)（）功能。
A.二進(jìn)制模十計(jì)數(shù)器
B.8421碼模十計(jì)數(shù)器
C.5421碼模十計(jì)數(shù)器
D.2421模十計(jì)數(shù)器
A.1
B.2
C.3
D.4
A.D
B.CD
C.C+D
D.1
最新試題
邏輯函數(shù)F（A，B，C，D）=∑m（2，7，8，12，13，14，15）的卡諾圖，下面畫法正確的是（）。
用5G555構(gòu)成的施密特觸發(fā)器具有（）個(gè)穩(wěn)態(tài)。
一個(gè)Moore型同步可重疊的“1011”序列檢測器的狀態(tài)圖是（）。
?用3線-8線譯碼器74138（邏輯符號(hào)如下圖所示）和與非門實(shí)現(xiàn)函數(shù)的功能時(shí)，74138的輸出端（）連接與非門。?
通常，使用參數(shù)（）來衡量D/A轉(zhuǎn)換器的轉(zhuǎn)換速度。
?下面關(guān)于用5G555構(gòu)成的施密特觸發(fā)器描述錯(cuò)誤的是（）。
?已知某異步時(shí)序電路的流程表如下表所示，其中x1和x2為電路輸入端。分析流程表，電路中有（）條反饋回路，當(dāng)（）時(shí)會(huì)發(fā)生臨界競爭。
設(shè)計(jì)一個(gè)Moore型同步可重疊的“1101”序列檢測器，至少需要（）個(gè)觸發(fā)器。
?已知描述某同步時(shí)序電路的狀態(tài)圖如下圖所示，假定輸入序列為x=01011011，初始狀態(tài)為A，則電路的狀態(tài)序列為（），輸出響應(yīng)序列為（）。
現(xiàn)場可編程門陣列FPGA的設(shè)計(jì)流程中，下列屬于規(guī)劃設(shè)計(jì)階段的工作有（）。