若邏輯函數(shù)
則F和G相與的結(jié)果為（）
A.A
B.B
C.C
D.D
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為實現(xiàn)D觸發(fā)器轉(zhuǎn)換為T觸發(fā)器，圖所示的虛線框內(nèi)應(yīng)是（）
A.或非門
B.與非門
C.異或門
D.同或門
A.2
B.3
C.1
D.4
下列觸發(fā)器中，沒法約束條件的是（）
A.A
B.B
C.C
D.D
A.真值表
B.狀態(tài)表
C.狀態(tài)圖
D.邏輯表達(dá)式
A.4入4出
B.8入8出
C.8入4出
D.8入5出
最新試題
TTL門電路具有負(fù)載能力強(qiáng)、抗干擾能力強(qiáng)和轉(zhuǎn)換速度高等特點。
?數(shù)字設(shè)計的層次主要有（）。
要使JK觸發(fā)器在時鐘脈沖作用下，實現(xiàn)輸出，則輸入信號應(yīng)為（）。
?十進(jìn)制數(shù)178.5對應(yīng)的余3碼是（）。
?如圖所示電路論述正確的是（）。
?若集成塊內(nèi)部為驅(qū)動單元提供的驅(qū)動能力為1X，對于下圖所示的輸出緩沖設(shè)計（圖中反相器上面標(biāo)注了相應(yīng)的驅(qū)動能力），該輸出單元的延遲時間（從a到y(tǒng)）相當(dāng)于（）個內(nèi)部標(biāo)準(zhǔn)門級聯(lián)的延遲時間。
?兩個二進(jìn)制數(shù)的補(bǔ)碼相加，有溢出的是（）。
?構(gòu)成數(shù)字電路最基本的器件主要有（）。
若集成塊內(nèi)部為驅(qū)動單元提供的驅(qū)動能力為1X，最小反相器（1X）延遲時間為2，對于下圖所示的輸出緩沖設(shè)計（圖中反相器上面標(biāo)注了相應(yīng)的驅(qū)動能力），該輸出單元的延遲時間（從a到y(tǒng)）最接近于（）。
約束項在函數(shù)化簡時可以當(dāng)作1，是因為在實際電路中，這種輸入組合根本不可能會讓其發(fā)生。