問答題
有一時(shí)序邏輯的原始狀態(tài)圖如題圖所示,請將這一原始狀態(tài)圖轉(zhuǎn)換成原始狀態(tài)表,用隱含表進(jìn)行化簡,并列出簡化狀態(tài)表。
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電平異步時(shí)序邏輯電路工作的基本條件有()。
題型:多項(xiàng)選擇題
假定某個(gè)電路如圖示,指示燈F和開關(guān)A、B、C的邏輯關(guān)系表達(dá)式為()。
題型:單項(xiàng)選擇題
用5G555構(gòu)成的施密特觸發(fā)器具有()個(gè)穩(wěn)態(tài)。
題型:單項(xiàng)選擇題
下面圖示的電路可以實(shí)現(xiàn)()功能。
題型:單項(xiàng)選擇題
下圖所示組合邏輯電路,輸入ABCD為8421碼,則電路的輸出WXYZ是()。
題型:單項(xiàng)選擇題
現(xiàn)場可編程門陣列FPGA的基本結(jié)構(gòu)由()組成。
題型:多項(xiàng)選擇題
?設(shè)計(jì)一個(gè)mealy型的110序列檢測器,需要()個(gè)觸發(fā)器,而設(shè)計(jì)moore型的110序列檢測器則需要()個(gè)觸發(fā)器。?
題型:單項(xiàng)選擇題
?已知脈沖異步時(shí)序邏輯電路如下圖所示,其功能是()。
題型:單項(xiàng)選擇題
?如下圖所示時(shí)序電路,該電路是一個(gè)()型電路,其功能是()。
題型:單項(xiàng)選擇題
現(xiàn)場可編程門陣列FPGA的設(shè)計(jì)流程中,下列屬于規(guī)劃設(shè)計(jì)階段的工作有()。
題型:多項(xiàng)選擇題