單項(xiàng)選擇題NI Multisim提供了哪些輔助工具來幫助學(xué)習(xí)電子設(shè)計(jì)和電路仿真?()
A.音頻編輯器
B.反應(yīng)堆設(shè)計(jì)工具
C.示波器
D.文字處理工具
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1.單項(xiàng)選擇題NI Multisim可以導(dǎo)出設(shè)計(jì)的電路為什么格式?()
A.文本文件格式
B.圖像文件格式
C.PDF文件格式
D.PCB設(shè)計(jì)文件格式
2.單項(xiàng)選擇題NI Multisim提供了哪種類型的仿真功能?()
A.機(jī)械仿真
B.電路仿真
C.化學(xué)反應(yīng)仿真
D.生物模擬仿真
3.多項(xiàng)選擇題用Verilog HDL設(shè)計(jì)系統(tǒng)時(shí),為了提高系統(tǒng)資源利用率(即面積優(yōu)化),可以使用哪些方法進(jìn)行優(yōu)化?()
A.流水線設(shè)計(jì)
B.資源共享
C.邏輯優(yōu)化
D.串行化
E.寄存器配平
F.關(guān)鍵路徑法
4.多項(xiàng)選擇題用Verilog HDL設(shè)計(jì)系統(tǒng)時(shí),為了提高系統(tǒng)運(yùn)行速度(即速度優(yōu)化),可以使用哪些方法進(jìn)行優(yōu)化?()
A.流水線設(shè)計(jì)
B.資源共享
C.邏輯優(yōu)化
D.串行化
E.寄存器配平
F.關(guān)鍵路徑法
5.多項(xiàng)選擇題以下方法屬于速度優(yōu)化方法的是()。
A.資源共享
B.邏輯優(yōu)化
C.流水線設(shè)計(jì)
D.寄存器配平
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在Cadence/OrCAD PSpice中,用于表示電阻器的元件是()。
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