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EDA技術(shù)填空題每日一練(2020.05.28)

來源：考試資料網(wǎng)

1.填空題在Verilog HDL的if語句中，系統(tǒng)對表達式的值進行判斷，若值為0，x或z，則按（）處理，若為1，則按（）處理。

參考答案：假；真

2.填空題MAX+plus Ⅱ支持原理圖、（）、（）語言及以波形與EDIF等格式的文件，并支持混合設(shè)計、（）仿真和（）仿真。

參考答案：VHDL；Verilog；功能；時序

3.填空題EDA技術(shù)的應(yīng)用可概括為（）、（）、（）三個方向。

參考答案：PCB設(shè)計；ASIC設(shè)計；CPLD/FPGA設(shè)計

4.填空題VHDL的短標識符名必須以（），后跟若干字母，數(shù)字和單個下劃線構(gòu)成，但最后不能為（）。

參考答案：字母開頭；下劃線

5.填空題NEXT語句主要用于在LOOP語句執(zhí)行中進行有條件的或無條件的（）控制。

參考答案：轉(zhuǎn)向

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