最新試題

如圖,此電路的輸入端I0_L是低電平有效,輸出A2A1A0是高電平有效,AVALID有效表示的是()。

題型:單項(xiàng)選擇題

CC4000系列的CMOS門電路不能直接接()系列的門電路。

題型:單項(xiàng)選擇題

要使JK觸發(fā)器在時(shí)鐘脈沖作用下,實(shí)現(xiàn)輸出,則輸入信號應(yīng)為()。

題型:單項(xiàng)選擇題

若集成塊內(nèi)部為驅(qū)動單元提供的驅(qū)動能力為1X,最小反相器(1X)延遲時(shí)間為2,對于下圖所示的輸出緩沖設(shè)計(jì)(圖中反相器上面標(biāo)注了相應(yīng)的驅(qū)動能力),該輸出單元的延遲時(shí)間(從a到y(tǒng))最接近于()。

題型:單項(xiàng)選擇題

?十進(jìn)制數(shù)22.37對應(yīng)的二進(jìn)制數(shù)是()。

題型:單項(xiàng)選擇題

輸出端不能直接線與的門電路有()。

題型:單項(xiàng)選擇題

?下圖邏輯單元實(shí)現(xiàn)的功能為()。

題型:單項(xiàng)選擇題

若集成塊內(nèi)部為驅(qū)動單元提供的驅(qū)動能力為1X,最小反相器(1X)延遲時(shí)間為2,對于下圖所示的輸出緩沖設(shè)計(jì)(圖中反相器上面標(biāo)注了相應(yīng)的驅(qū)動能力),該輸出單元的延遲時(shí)間(從a到y(tǒng))最接近于()。

題型:單項(xiàng)選擇題

?數(shù)字設(shè)計(jì)的層次主要有()。

題型:多項(xiàng)選擇題

二進(jìn)制加法運(yùn)算包含的輸入、輸出變量有()。

題型:多項(xiàng)選擇題