?下圖邏輯單元實(shí)現(xiàn)的功能為()。
A.y=(a+b.c)’
B.y=a+b.c
C.y=a.b+c
D.y=(a.b+c)’
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電路結(jié)構(gòu)如圖所示,該電路是()。
A.INV
B.BUFFER
C.NAND2
D.OR2
A.10110.0101111
B.10010.01011
C.10110.11010
D.10010.010110
A.000101111000.0101
B.010001111000.0101
C.010010101011.1000
D.010010101110.1001
A.進(jìn)位輸入:C in
B.進(jìn)位輸出C out
C.本位差:D
D.本位和:S
A.IC制造過(guò)程級(jí)
B.晶體管級(jí)
C.門電路結(jié)構(gòu)級(jí)
D.邏輯設(shè)計(jì)級(jí)
最新試題
關(guān)于集成塊的輸出單元,下列說(shuō)法中正確的是()。
?十進(jìn)制數(shù)22.37對(duì)應(yīng)的二進(jìn)制數(shù)是()。
與模擬電路相比,數(shù)字系統(tǒng)的優(yōu)越性主要體現(xiàn)在()。
?利用開(kāi)關(guān)代數(shù)的公理或定理,判斷與(x+y’)’等價(jià)的邏輯關(guān)系為()。
約束項(xiàng)在函數(shù)化簡(jiǎn)時(shí)可以當(dāng)作1,是因?yàn)樵趯?shí)際電路中,這種輸入組合根本不可能會(huì)讓其發(fā)生。
?BCD碼譯碼器如果不允許輸入大于9的數(shù)值的時(shí)候,當(dāng)輸入10時(shí),輸出為()。
要使CMOS門輸入高電平,不能使用的方法為()。
?構(gòu)成數(shù)字電路最基本的器件主要有()。
CC4000系列的CMOS門電路不能直接接()系列的門電路。
對(duì)于D觸發(fā)器,如果時(shí)鐘頻率為10MHz,輸出信號(hào)Q的頻率可能是()MHz。