單項(xiàng)選擇題

在正常工作時，3-8線譯碼器74138的使能端的值為（）。

A.000
B.100
C.011
D.111


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1.多項(xiàng)選擇題電平異步時序邏輯電路工作的基本條件有（）。

A.不允許兩個或兩個以上的輸入信號同時變化
B.輸入信號變化引起的電路響應(yīng)必須完全結(jié)束，輸入信號才能夠再次變化
C.不允許輸入是脈沖信號
D.不允許兩個或兩個以上的輸入信號同時為高電平

3.單項(xiàng)選擇題

下圖所示電路的功能是（）。

A.模2計(jì)數(shù)器
B.模3計(jì)數(shù)器
C.模4計(jì)數(shù)器
D.模5計(jì)數(shù)器

4.多項(xiàng)選擇題現(xiàn)場可編程門陣列FPGA的設(shè)計(jì)流程中，下列屬于規(guī)劃設(shè)計(jì)階段的工作有（）。

A.確定系統(tǒng)功能和模塊劃分
B.創(chuàng)建或添加設(shè)計(jì)源文件、約束文件
C.選擇合適的設(shè)計(jì)方案
D.生成邏輯連接網(wǎng)表

5.多項(xiàng)選擇題現(xiàn)場可編程門陣列FPGA的基本結(jié)構(gòu)由（）組成。

A.可編程配置塊
B.可編程輸入/輸出
C.可編程互聯(lián)資源
D.可編程或陣列

最新試題

假定某個電路如圖示，指示燈F和開關(guān)A、B、C的邏輯關(guān)系表達(dá)式為（）。

題型：單項(xiàng)選擇題

使用8路選擇器實(shí)現(xiàn)4變量邏輯函數(shù)F（A，B，C，D），使用ABC作為控制變量，數(shù)據(jù)輸入端D0-D7可能的值有（）。

題型：多項(xiàng)選擇題

?已知脈沖異步時序邏輯電路如下圖所示，其功能是（）。

題型：單項(xiàng)選擇題

下圖所示的PLD連接表示的輸出函數(shù)表達(dá)式F等于（）。

題型：單項(xiàng)選擇題

反映TTL與非門輸入高電平時抗干擾能力的外部特性參數(shù)是（）。

題型：單項(xiàng)選擇題

?已知某異步時序電路的流程表如下表所示，其中x1和x2為電路輸入端。分析流程表，電路中有（）條反饋回路，當(dāng)（）時會發(fā)生臨界競爭。

題型：單項(xiàng)選擇題

設(shè)計(jì)一個Moore型同步可重疊的“1101”序列檢測器，至少需要（）個觸發(fā)器。

題型：單項(xiàng)選擇題

用5G555構(gòu)成的施密特觸發(fā)器具有（）個穩(wěn)態(tài)。

題型：單項(xiàng)選擇題

?用3線-8線譯碼器74138（邏輯符號如下圖所示）和與非門實(shí)現(xiàn)函數(shù)的功能時，74138的輸出端（）連接與非門。?

題型：單項(xiàng)選擇題

?具有3個選擇控制端的數(shù)據(jù)選擇器能對（）個輸入數(shù)據(jù)進(jìn)行選擇，對應(yīng)選擇輸入端的任何一種取值，可選中（）個輸入數(shù)據(jù)輸出。?

題型：單項(xiàng)選擇題