填空題對于D觸發(fā)器,若現(xiàn)態(tài)Qn=0,要使次態(tài)Qn+1=0,則輸入D=()
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電路結(jié)構(gòu)如圖所示,該電路是()。
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如圖電路實現(xiàn)的邏輯函數(shù)是()。
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CC4000系列的CMOS門電路不能直接接()系列的門電路。
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?若集成塊內(nèi)部為驅(qū)動單元提供的驅(qū)動能力為1X,對于下圖所示的輸出緩沖設(shè)計(圖中反相器上面標注了相應(yīng)的驅(qū)動能力),該輸出單元的延遲時間(從a到y(tǒng))相當于()個內(nèi)部標準門級聯(lián)的延遲時間。
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已知函數(shù)F(A,B,C,D)=(AB’)’+(C’D+B’C)’,則其最簡表達式為()。
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如圖,此電路的輸入端I0_L是低電平有效,輸出A2A1A0是高電平有效,AVALID有效表示的是()。
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?如圖所示電路論述正確的是()。
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與模擬電路相比,數(shù)字系統(tǒng)的優(yōu)越性主要體現(xiàn)在()。
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使用74HC138實現(xiàn)邏輯函數(shù)正確的是()。
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對于D觸發(fā)器,如果時鐘頻率為10MHz,輸出信號Q的頻率可能是()MHz。
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