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下圖是共陰極七段LED數(shù)碼管顯示譯碼器框圖，若要顯示字符“5”，則譯碼器輸出a～g應(yīng)為（）
A.0100100
B.1100011
C.1011011
D.0011011
A.計數(shù)器
B.譯碼器
C.加法器
D.多路選擇器
如圖所示電路，若輸入CP脈沖的頻率為100KHZ，則輸出Q的頻率為（）
A.500KHz
B.200KHz
C.100KHz
D.50KHz
下列所給三態(tài)門中，能實現(xiàn)C=0時，
C=1時，F(xiàn)為高阻態(tài)的邏輯功能的是（）
A.
B.
C.
D.
最新試題
使用74HC138實現(xiàn)邏輯函數(shù)正確的是（）。
?十進制數(shù)22.37對應(yīng)的二進制數(shù)是（）。
?兩個二進制數(shù)的補碼相加，有溢出的是（）。
如圖，是151的電路設(shè)計，其中輸入端的使用了6個反相器，而實現(xiàn)邏輯功能應(yīng)該可以省掉三個，為什么這么設(shè)計（）。
要使TTL與非門變成反相器，多余的輸入端不能采用的方法為（）。
二進制加法運算包含的輸入、輸出變量有（）。
關(guān)于集成塊的輸出單元，下列說法中正確的是（）。
?數(shù)字設(shè)計的層次主要有（）。
要使CMOS門輸入高電平，不能使用的方法為（）。
?若集成塊內(nèi)部為驅(qū)動單元提供的驅(qū)動能力為1X，對于下圖所示的輸出緩沖設(shè)計（圖中反相器上面標(biāo)注了相應(yīng)的驅(qū)動能力），該輸出單元的延遲時間（從a到y(tǒng)）相當(dāng)于（）個內(nèi)部標(biāo)準(zhǔn)門級聯(lián)的延遲時間。