單項(xiàng)選擇題CG放大器具有較（）的輸入電阻和較（）的輸出電阻。?
A.高，高
B.高，低
C.低，高
D.低，低
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1.單項(xiàng)選擇題CD放大器具有較（）的輸入電阻和較（）的輸出電阻。?????
A.高，高
B.高，低
C.低，高
D.低，低
5.多項(xiàng)選擇題當(dāng)VGS=0時(shí)，能夠?qū)ǖ腗OS管為（）
A.NEMOSFET
B.NDMOSFET
C.PEMOSFET
D.PDMOSFET
最新試題
?CS放大器中引入源極電阻RS，其作用有（）。?
題型：多項(xiàng)選擇題
?在使用verilog描述一個(gè)二選一的數(shù)據(jù)選擇器時(shí)，使用一條語(yǔ)句來(lái)進(jìn)行描述assign out1=（sel &b）∣（~sel &a），這條語(yǔ)句對(duì)應(yīng)的是（）。
題型：?jiǎn)雾?xiàng)選擇題
用作電壓放大器時(shí)，CS放大器不合適的參數(shù)為（）。?
題型：?jiǎn)雾?xiàng)選擇題
?TTL或非門(mén)組成的邏輯電路如圖所示，當(dāng)輸入為以下哪種狀態(tài)時(shí)會(huì)出現(xiàn)冒險(xiǎn)現(xiàn)象？（）
題型：?jiǎn)雾?xiàng)選擇題
?電路如圖所示，如果電容C2開(kāi)路，則MOSFET的漏極直流電壓將會(huì)（），漏極交流電壓將會(huì)（），增益將會(huì)（）。
題型：?jiǎn)雾?xiàng)選擇題
?若某放大器的輸入信號(hào)為電壓信號(hào)，輸出信號(hào)為電流信號(hào)，則以下描述正確的有（）。?
題型：多項(xiàng)選擇題
I=0.5mA，Vt=1.5V，k′n（W/L）=1mA/V2，VA足夠大。輸入輸出信號(hào)均通過(guò)電容耦合進(jìn)行傳輸（注意圖中未畫(huà)出電容），要實(shí)現(xiàn)增益為15倍的放大電路，則RD=（）kΩ。?
題型：?jiǎn)雾?xiàng)選擇題
?verilog語(yǔ)法中，間隔符號(hào)主要包括（）。
題型：多項(xiàng)選擇題
?verilogHDL中已經(jīng)預(yù)先定義了的門(mén)級(jí)原型的符號(hào)有（）。
題型：多項(xiàng)選擇題
可以通過(guò)新增以下哪些類型文件添加ChipScope調(diào)試IP核？（）
題型：多項(xiàng)選擇題