問(wèn)答題
采用降維法用一片集成8選1數(shù)據(jù)選擇器CT74151和必要的門(mén)電路實(shí)現(xiàn)下列邏輯函數(shù)。
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反映TTL與非門(mén)輸入高電平時(shí)抗干擾能力的外部特性參數(shù)是()。
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用PROM設(shè)計(jì)一個(gè)2位二進(jìn)制平方器,實(shí)現(xiàn)該平方器需要的容量至少為()。
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如下圖所示的原始狀態(tài)表,其中的等效對(duì)有()。
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為了實(shí)現(xiàn)計(jì)數(shù)功能,集成寄存器74194的控制端S0S1可以是()。
題型:多項(xiàng)選擇題
通常,使用參數(shù)()來(lái)衡量D/A轉(zhuǎn)換器的轉(zhuǎn)換速度。
題型:?jiǎn)雾?xiàng)選擇題
下圖所示CMOS電路實(shí)現(xiàn)的邏輯是()。
題型:?jiǎn)雾?xiàng)選擇題
一個(gè)Moore型同步可重疊的“1011”序列檢測(cè)器的狀態(tài)圖是()。
題型:?jiǎn)雾?xiàng)選擇題
假定某個(gè)電路如圖示,指示燈F和開(kāi)關(guān)A、B、C的邏輯關(guān)系表達(dá)式為()。
題型:?jiǎn)雾?xiàng)選擇題
下圖所示的PLD連接表示的輸出函數(shù)表達(dá)式F等于()。
題型:?jiǎn)雾?xiàng)選擇題
下圖所示電路的功能是()。
題型:?jiǎn)雾?xiàng)選擇題