A.1
B.4
C.3
D.5
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現(xiàn)在定義了一個1位的加法器addbit(ci,a,b,co,sum),模塊的結果用表達式表示為{co,sub}=a+b+ci,其中a,b為兩個加數(shù),ci為來自低位的進位,sum為和,co為向高位的進位,如果以此1位加法器構建四位加法器,同時定義頂層模塊中的端口信號和中間變量的定義:
下面通過層次調用的方式進行邏輯實現(xiàn)中的表達式正確的是()。
A.addbit U0(r1[0],r2[0],ci,result[0],cl)
B.addbit (r1[0],r2[0],ci,result[0],c1)
C.addbit U0(ci,r1[0],r2[0],cl,result[0])
D.addbit (r1,r2,ci,result,c1)
A.過程描述方式
B.行為描述方式
C.數(shù)據(jù)流描述方式
D.尋跡描述方式
A./*...*/
B.{...}
C.begin...end
D.module...endmodule
?TTL或非門組成的邏輯電路如圖所示,當輸入為以下哪種狀態(tài)時會出現(xiàn)冒險現(xiàn)象?()
A.A =1,B =0,D =0
B.A =0,B =1,D =1
C.A =1,B =1,D =0
D.A =0,B =1,C =1
?某次電路實驗中,一同學按如下電路圖連接電路,完成實驗。其中D0,D1端為輸入端,S0與S1為輸出端。在實驗過程中,該同學觀測到輸出端S0,S1端輸出電平分別為邏輯高電平,邏輯低電平。請問此刻電路輸入端D0,D1電平可能分別為()。
A.高電平,高電平
B.低電平,高電平
C.高電平,低電平
D.低電平,低電平
最新試題
用作電壓放大器時,CS放大器不合適的參數(shù)為()。?
在對數(shù)字鐘計時、校時模塊進行仿真時,設秒信號的周期為10ns,若要觀察24時制計數(shù)是否正確,那么在復位信號無效,計時使能信號有效的情況下,仿真需運行多長時間?()
以下哪個MOS放大器組態(tài)結構最適合用在電壓信號處理系統(tǒng)的最后一級??()
?CS、CG和CD三種組態(tài)中,最適合做電壓放大器的還是CS放大器。
CG放大器因其輸入電阻過小,因此沒什么用處。
?若某放大器的輸入信號為電壓信號,輸出信號為電流信號,則以下描述正確的有()。?
?某次電路實驗中,一同學按如下電路圖連接電路,完成實驗。其中D0,D1端為輸入端,S0與S1為輸出端。在實驗過程中,該同學觀測到輸出端S0,S1端輸出電平分別為邏輯高電平,邏輯低電平。請問此刻電路輸入端D0,D1電平可能分別為()。
當VGS=0時,能夠導通的MOS管為()
?數(shù)字頻率計設計中的測頻計數(shù)模塊共有多少個狀態(tài)?()
?verilog語法中,間隔符號主要包括()。