問(wèn)答題試用邏輯門(mén)設(shè)計(jì)一個(gè)帶控制端的半加/半減器,控制端X=1時(shí)為半加器,X=0時(shí)為半減器。
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已知有二輸入邏輯門(mén),只有當(dāng)輸X和Y都為1時(shí),輸出F才為1,則X,Y與F的邏輯關(guān)系為()。
題型:?jiǎn)雾?xiàng)選擇題
?下圖邏輯單元實(shí)現(xiàn)的功能為()。
題型:?jiǎn)雾?xiàng)選擇題
為實(shí)現(xiàn)將D觸發(fā)器轉(zhuǎn)換為T(mén)觸發(fā)器,下圖所示電路的虛框內(nèi)應(yīng)是()。
題型:?jiǎn)雾?xiàng)選擇題
要使TTL與非門(mén)變成反相器,多余的輸入端不能采用的方法為()。
題型:?jiǎn)雾?xiàng)選擇題
對(duì)于D觸發(fā)器,如果時(shí)鐘頻率為10MHz,輸出信號(hào)Q的頻率可能是()MHz。
題型:多項(xiàng)選擇題
?十進(jìn)制數(shù)22.37對(duì)應(yīng)的二進(jìn)制數(shù)是()。
題型:?jiǎn)雾?xiàng)選擇題
?如圖所示電路論述正確的是()。
題型:多項(xiàng)選擇題
CC4000系列的CMOS門(mén)電路不能直接接()系列的門(mén)電路。
題型:?jiǎn)雾?xiàng)選擇題
已知函數(shù)F(A,B,C,D)=(AB’)’+(C’D+B’C)’,則其最簡(jiǎn)表達(dá)式為()。
題型:?jiǎn)雾?xiàng)選擇題
?如圖電路,描述正確的是()。
題型:?jiǎn)雾?xiàng)選擇題