A.固定；可編程
B.可編程；可編程
C.固定；固定
D.可編程；固定
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A.n
B.2n
C.2n-1
D.2n-2n
A.3
B.4
C.5
D.10
電路如下圖所示，經(jīng)CP脈沖作用后，欲使Qn+1=Q，則A，B輸入應(yīng)為（）。
A.A=0，B=0
B.A=1，B=1
C.A=0，B=1
D.A=1，B=0
A.觸發(fā)器
B.門(mén)電路
C.計(jì)數(shù)器
D.寄存器
A.PROM
B.PAL
C.PLA
D.GAL
最新試題
?當(dāng)共陰極7段數(shù)碼管顯示2的時(shí)候，輸出應(yīng)該為（）。
?兩個(gè)二進(jìn)制數(shù)的補(bǔ)碼相加，有溢出的是（）。
為實(shí)現(xiàn)將D觸發(fā)器轉(zhuǎn)換為T(mén)觸發(fā)器，下圖所示電路的虛框內(nèi)應(yīng)是（）。
已知函數(shù)F（A，B，C，D）=（AB’）’+（C’D+B’C）’，則其最簡(jiǎn)表達(dá)式為（）。
若集成塊內(nèi)部為驅(qū)動(dòng)單元提供的驅(qū)動(dòng)能力為1X，最小反相器（1X）延遲時(shí)間為2，對(duì)于下圖所示的輸出緩沖設(shè)計(jì)（圖中反相器上面標(biāo)注了相應(yīng)的驅(qū)動(dòng)能力），該輸出單元的延遲時(shí)間（從a到y(tǒng)）最接近于（）。
如圖電路實(shí)現(xiàn)的邏輯函數(shù)是（）。
對(duì)于D觸發(fā)器，如果時(shí)鐘頻率為10MHz，輸出信號(hào)Q的頻率可能是（）MHz。
CC4000系列的CMOS門(mén)電路不能直接接（）系列的門(mén)電路。
?十進(jìn)制數(shù)22.37對(duì)應(yīng)的二進(jìn)制數(shù)是（）。
?BCD碼譯碼器如果不允許輸入大于9的數(shù)值的時(shí)候，當(dāng)輸入10時(shí)，輸出為（）。