A.n
B.2n
C.2n-1
D.2n-2n
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A.3
B.4
C.5
D.10
電路如下圖所示,經(jīng)CP脈沖作用后,欲使Qn+1=Q,則A,B輸入應(yīng)為()。
A.A=0,B=0
B.A=1,B=1
C.A=0,B=1
D.A=1,B=0
A.觸發(fā)器
B.門(mén)電路
C.計(jì)數(shù)器
D.寄存器
A.PROM
B.PAL
C.PLA
D.GAL
A.R-S型
B.J-K型
C.主從型
D.同步型
最新試題
如圖,此電路的輸入端I0_L是低電平有效,輸出A2A1A0是高電平有效,AVALID有效表示的是()。
若集成塊內(nèi)部為驅(qū)動(dòng)單元提供的驅(qū)動(dòng)能力為1X,最小反相器(1X)延遲時(shí)間為2,對(duì)于下圖所示的輸出緩沖設(shè)計(jì)(圖中反相器上面標(biāo)注了相應(yīng)的驅(qū)動(dòng)能力),該輸出單元的延遲時(shí)間(從a到y(tǒng))最接近于()。
?下圖邏輯單元實(shí)現(xiàn)的功能為()。
?十進(jìn)制數(shù)22.37對(duì)應(yīng)的二進(jìn)制數(shù)是()。
關(guān)于集成塊的輸出單元,下列說(shuō)法中正確的是()。
使用74HC138實(shí)現(xiàn)邏輯函數(shù)正確的是()。
TTL門(mén)電路具有負(fù)載能力強(qiáng)、抗干擾能力強(qiáng)和轉(zhuǎn)換速度高等特點(diǎn)。
若n個(gè)變量的同或運(yùn)算和異或運(yùn)算結(jié)果相同,則n為奇數(shù)()
?利用開(kāi)關(guān)代數(shù)的公理或定理,判斷與(x+y’)’等價(jià)的邏輯關(guān)系為()。
?當(dāng)共陰極7段數(shù)碼管顯示2的時(shí)候,輸出應(yīng)該為()。