A.3
B.4
C.5
D.10
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A.固定；可編程
B.可編程；固定
C.固定；固定
D.可編程；可編程
A.譯碼器
B.編碼器
C.全加器
D.寄存器
下列時(shí)序電路的狀態(tài)圖中，具有自啟動(dòng)功能的是（）
A.A
B.B
C.C
D.D
圖示ROM陣列邏輯圖，當(dāng)?shù)刂窞锳1A0=10時(shí)，該字單元的內(nèi)容為（）
A.1110
B.0111
C.1010
D.0100
函數(shù)F=
+AB轉(zhuǎn)換成或非－或非式為（）
A.A
B.B
C.C
D.D
最新試題
為實(shí)現(xiàn)將D觸發(fā)器轉(zhuǎn)換為T觸發(fā)器，下圖所示電路的虛框內(nèi)應(yīng)是（）。
已知函數(shù)F（A，B，C，D）=（AB’）’+（C’D+B’C）’，則其最簡(jiǎn)表達(dá)式為（）。
?當(dāng)共陰極7段數(shù)碼管顯示2的時(shí)候，輸出應(yīng)該為（）。
二進(jìn)制加法運(yùn)算包含的輸入、輸出變量有（）。
對(duì)于D觸發(fā)器，如果時(shí)鐘頻率為10MHz，輸出信號(hào)Q的頻率可能是（）MHz。
如圖所示，則F=（）。
?利用開(kāi)關(guān)代數(shù)的公理或定理，判斷與（x+y’）’等價(jià)的邏輯關(guān)系為（）。
?構(gòu)成數(shù)字電路最基本的器件主要有（）。
若集成塊內(nèi)部為驅(qū)動(dòng)單元提供的驅(qū)動(dòng)能力為1X，最小反相器（1X）延遲時(shí)間為2，對(duì)于下圖所示的輸出緩沖設(shè)計(jì)（圖中反相器上面標(biāo)注了相應(yīng)的驅(qū)動(dòng)能力），該輸出單元的延遲時(shí)間（從a到y(tǒng)）最接近于（）。
?BCD碼譯碼器如果不允許輸入大于9的數(shù)值的時(shí)候，當(dāng)輸入10時(shí)，輸出為（）。