單項選擇題以下集成電路版圖(Layout)設(shè)計技術(shù)及方法,不正確的是()。
A.版圖設(shè)計之前需要科學規(guī)劃
B.合理設(shè)計金屬連線的寬度
C.襯底應(yīng)該保證良好的接地
D.電路中較長的走線,不需要考慮到電阻效應(yīng)
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1.單項選擇題集成電路設(shè)計及制造中,版圖(Layout)與掩膜(Mask)的關(guān)系是()。?
A.根據(jù)版圖提供的信息來制造掩膜
B.根據(jù)掩膜提供的信息來設(shè)計版圖
C.版圖(Layout)與掩膜(Mask)的毫無關(guān)系
D.不確定
2.單項選擇題集成電路制造工藝中,以下對氧化速率沒有影響的因素是()。?
A.溫度
B.厚度
C.硅晶向
D.摻雜
3.單項選擇題集成電路制造工藝中,以下不是熱氧化方法的是()。?
A.干氧氧化
B.濕氧氧化
C.離子氧化
D.水蒸汽氧化
4.單項選擇題集成電路制造工藝中,二氧化硅膜不能用于()。?
A.元器件的組成部分(如柵氧化層)
B.源漏極
C.互連層間絕緣介質(zhì)
D.作為掩蔽膜
5.單項選擇題以下對集成電路版圖設(shè)計中幾何設(shè)計規(guī)則描述不正確的是()。?
A.幾何設(shè)計規(guī)則是版圖圖形編輯的依據(jù)
B.幾何設(shè)計規(guī)則是設(shè)計系統(tǒng)生成版圖的依據(jù)
C.幾何設(shè)計規(guī)則是分析計算的依據(jù)
D.幾何設(shè)計規(guī)則是檢查版圖錯誤的依據(jù)
最新試題
常規(guī)芯片封裝生產(chǎn)過程包括粘裝和引線鍵合兩個工序,而倒裝芯片則合二為一。
題型:判斷題
引線鍵合的常用技術(shù)有()。
題型:多項選擇題
下列關(guān)于BGA球柵陣列的優(yōu)缺點,說法正確的是()。
題型:多項選擇題
制造和封裝工藝過程中的材料性能是決定材料應(yīng)用的關(guān)鍵,制造性能主要包括()。
題型:多項選擇題
下列屬于BGAA形式的是()。
題型:多項選擇題
去飛邊毛刺工藝主要有介質(zhì)去飛邊毛刺、溶劑去飛邊毛刺、水去飛邊毛刺。
題型:判斷題
通常芯片上的引出端焊盤是排列在管芯片附近的方形()。
題型:單項選擇題
因為QFP封裝的可靠性高,且其封裝外形尺寸較小,寄生參數(shù)減小,故多用于高頻電路、音頻電路、微處理器、電源電路。
題型:判斷題
下面關(guān)于PBGA器件的優(yōu)缺點,說法錯誤的是()。
題型:單項選擇題
下面不屬于QFP封裝改進品質(zhì)的是()。
題型:單項選擇題